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Volumn , Issue , 2008, Pages 61-62

Insights into gate-underlap design in double gate based 6-T SRAM cell for low voltage applications

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EID: 57749195115     PISSN: 1078621X     EISSN: None     Source Type: Conference Proceeding    
DOI: 10.1109/SOI.2008.4656294     Document Type: Conference Paper
Times cited : (2)

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* 이 정보는 Elsevier사의 SCOPUS DB에서 KISTI가 분석하여 추출한 것입니다.