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Volumn , Issue , 2000, Pages 601-606

Optimizing sequential verification by retiming transformations

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ALGORITHMS; FINITE AUTOMATA; SEQUENTIAL CIRCUITS; TIMING CIRCUITS;

EID: 0033700098     PISSN: 0738100X     EISSN: None     Source Type: Conference Proceeding    
DOI: 10.1145/337292.337591     Document Type: Conference Paper
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* 이 정보는 Elsevier사의 SCOPUS DB에서 KISTI가 분석하여 추출한 것입니다.