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Volumn 47, Issue 2 I, 2000, Pages 362-366

Pattern recognition algorithms on FPGAs and CPUs for the ATLAS LVL2 trigger

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ALGORITHMS; COMPUTER ARCHITECTURE; DATA PROCESSING; FEATURE EXTRACTION; FIELD PROGRAMMABLE GATE ARRAYS; PERSONAL COMPUTERS;

EID: 0033690788     PISSN: 00189499     EISSN: None     Source Type: Journal    
DOI: 10.1109/23.846182     Document Type: Article
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References (10)
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* 이 정보는 Elsevier사의 SCOPUS DB에서 KISTI가 분석하여 추출한 것입니다.