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Volumn , Issue , 1997, Pages 636-641

Test generation for primitive path delay faults in combinational circuits

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INTEGRATED CIRCUIT TESTING; MATHEMATICAL MODELS;

EID: 0031378507     PISSN: 10923152     EISSN: None     Source Type: Conference Proceeding    
DOI: 10.1109/iccad.1997.643605     Document Type: Conference Paper
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References (18)
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* 이 정보는 Elsevier사의 SCOPUS DB에서 KISTI가 분석하여 추출한 것입니다.