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Volumn , Issue , 1997, Pages 540-541

Novel hierarchical test generation method for processors

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CONTROL; DESIGN; TESTING; VLSI CIRCUITS;

EID: 0030857738     PISSN: None     EISSN: None     Source Type: Conference Proceeding    
DOI: None     Document Type: Conference Paper
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* 이 정보는 Elsevier사의 SCOPUS DB에서 KISTI가 분석하여 추출한 것입니다.